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发布时间:2019-06-09来源:本站原创

  当电压脉冲信号幅度大于阈值电压Vref(调试过程中设定Vref为0.5V,电压低于0.5V的即可认为是噪声而不予考虑),比力器U1输出高电平,发生上升沿,上升沿再触发U3A,它的Q端输出高电安然平静峰值将来到时U3B的Qˉ端相取得高电平,去节制LF398的采样节制端进入采样形态。当脉冲信号达到峰值后,比力器U2输出高电平,获得上升沿,上升沿再触发U3B,它的Qˉ端输出低电平,U5输出低电平,LF398进入连结形态。U3B的Qˉ端输出的下降沿做为DSP捕捉单位CAP3中缀的启动信号,CAP3发出信号去启动ADC,当A/D转换竣事后,DSP的GPIO口输出一个低电平做为U3的清零信号CLR,双D触发器74LS74清零后,LF398的采样节制端从头进入采样形态,预备连结下一个脉冲的峰值。

  74LS08:取门,细致地说是4二输入取门,即一片74LS08芯片内有共四路二个输入端的取门。

  DC/DC电源隔离转换和滤波电路为CAN通信接口电路供给电源,并实现取内部电路的隔离,电路如图5所示。

  从图中可知,同发送按时信号类同,发生按时信号的方式也不异,故波形略。需要指出的是,U213:A、B(74LS04)、U203:B(74LS74)的感化是对领受到的数字基带信号进行整形输出。

  为了提高系统的抗干扰能力,正在CAN节制器和CAN驱动器之间插手了利用高速光电隔离器件6N137形成的隔离电路,如图2所示。

  如图5所示,U4是芯片LF398,它是美国半导体公司研制的集成采样连结器。它只需外接一个连结电容就能完成采样连结功能,其采样连结节制端可间接接于TTL,CMOS逻辑电平。U1和U2是高速电压比力器LM311,U3是上升沿触发的双D触发器,U5是取门74LS08.颠末从放大电路处置后的脉冲信号一路输入到阈值比力器U1,另一路输入到由比力器U2构成的峰值检测电路(R3C1构成延迟电路取U2反向输入端输入的脉冲信号进行比力,用于判断脉冲信号的峰值能否到来),还有一路输入到采样连结器LF398,并且LF398的输出接到DSP内ADC模块的ADCINA0引脚上。

  颠末从放大电路处置后的脉冲信号虽然幅度较为抱负,但脉冲宽度仍然较小,最小脉宽只要1ms.而A/D转换需要必然的时间,要采到脉冲的尖峰需要对峰值电压进行连结,同时向DSP提出中缀请求信号,使DSP响应中缀并启动A/D转换,转换竣事后DSP使采样连结器回复复兴为采样形态,实现系统的逻辑节制,本文设想的峰值连结电路如图所示。

  CAN总线是CAN节制器和物理总线间的接口,供给对总线的差动发送能力和对CAN节制器的差动领受能力,它取ISO11898尺度兼容,有高速、斜率节制和待机三种工做体例,可按照现实环境选择。


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